| Icarus verilog. verilog סימולציה כלי סינתזה |
הורד עכשיו |
Icarus verilog. דירוג וסיכום
- שם המפרסם:
- Stephen Williams
- אתר האינטרנט של המוציא לאור:
- http://icarus.com/eda/verilog/
Icarus verilog. תגים
Icarus verilog. תיאור
סימולציה Verilog ו סינתזה כלי Verilog Icarus הוא סימולציה Verilog כלי סינתזה. זה פועל כמו מהדר, קומפילציה קוד המקור writen Verilog (IEEE-1364) לתוך פורמט היעד כלשהו. עבור סימולציה אצווה, המהדר יכול ליצור טופס ביניים הנקרא VVP הרכבה. טופס ביניים זה מבוצע על ידי הפקודה 'VVP' '. עבור סינתזה, המהדר מייצר netlists בפורמט הרצוי. המהדר הנכון נועד לפרט ולנתח תיאורים עיצוב כתוב על תקן IEEE IEEE STD 1364-2001. תקן תקין שוחרר לכיוון אמצע השנה 2001, אם כי בצורה אלקטרונית יקר למדי. זה גדול למדי סטנדרטי מורכב, אז זה ייקח קצת זמן כדי להגיע לשם, אבל זה המטרה .Note: איקרוס Verilog היא עבודה בתהליך, ומאז תקן השפה לא עומד עדיין, זה כנראה תמיד יהיה.
Icarus verilog. תוכנה קשורה